應(yīng)屆畢業(yè)生
學(xué)歷不限
2026-04-08 11:40:16
2179人關(guān)注
職位描述
該職位信息待核驗，請仔細了解后再進行投遞！
崗位職責(zé)
1.負責(zé)IP和SOC驗證
2.理解設(shè)計需求， 建立IP、SOC驗證計劃
3.負責(zé)IP驗證環(huán)境的搭建,執(zhí)行驗證計劃，驗證用例的開發(fā)和回歸，分析和提高功能覆蓋率和代碼覆蓋率，確保驗證的完整性， 保證設(shè)計質(zhì)量。
4.支持FPGA驗證和測試用例的開發(fā)和回片測試debug。
任職要求
1.電子相關(guān)專業(yè)本科以上學(xué)歷， 2年以上驗證相關(guān)工作經(jīng)驗。
2.熟悉system Verilog和UVM方法學(xué)，以及各種驗證組件的實現(xiàn)（assertion， checker， monitor等）， 能夠獨立搭建模塊級驗證環(huán)境
3.熟悉邏輯設(shè)計和Verilog語言， 熟悉MCU架構(gòu)和設(shè)計（CPU，總線，中斷， DMA， 時鐘等）者優(yōu)先。
4.熟練掌握至少一種腳本語言， TCL、Perl， Python， C-shell 等
工作地點：上海/蘇州/天津均可
1.負責(zé)IP和SOC驗證
2.理解設(shè)計需求， 建立IP、SOC驗證計劃
3.負責(zé)IP驗證環(huán)境的搭建,執(zhí)行驗證計劃，驗證用例的開發(fā)和回歸，分析和提高功能覆蓋率和代碼覆蓋率，確保驗證的完整性， 保證設(shè)計質(zhì)量。
4.支持FPGA驗證和測試用例的開發(fā)和回片測試debug。
任職要求
1.電子相關(guān)專業(yè)本科以上學(xué)歷， 2年以上驗證相關(guān)工作經(jīng)驗。
2.熟悉system Verilog和UVM方法學(xué)，以及各種驗證組件的實現(xiàn)（assertion， checker， monitor等）， 能夠獨立搭建模塊級驗證環(huán)境
3.熟悉邏輯設(shè)計和Verilog語言， 熟悉MCU架構(gòu)和設(shè)計（CPU，總線，中斷， DMA， 時鐘等）者優(yōu)先。
4.熟練掌握至少一種腳本語言， TCL、Perl， Python， C-shell 等
工作地點：上海/蘇州/天津均可
注：聯(lián)系我時，請說是在河南人才網(wǎng)上看到的。
工作地點
地址：上海浦東新區(qū)祥科路268號3層308室
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